SystemVerilog硬件设计及建模 在线电子书 图书标签: SystemVerilog  ASIC  编程  集成电路  计算机  技术  工作  2013   

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看英文前可以先看下，讲的是可综合的东东，几乎没有设计验证，但是SV做验证很强大。

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书中深入浅出地介绍SystemVerilog相比于Verilog新增加的特性。想对systemverilog有整体的了解的可以看这本(不过只是可综合部分，另有systemverilog面向对象的语法部分没有提到，需要看另外一本 systemverilog for Verification)。主要是针对design。

想用systemverilog做设计的人必读。验证的人需要读另外一本systemverilog for verification. 还没有中文版。

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这本书主要是从硬件方面来对SV进行介绍的，也就是介绍SV在硬件实现方面的强大功能。 很好的一点是，它是对照着verilog来介绍的。同样的功能，Verilog会怎样处理，而SV又会怎样处理，这样能够很容易地加深对SV的理解。 看这本书用了我2天的时间。当然，只是粗略读了一遍，但是...

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